arm: Fix MVE vmla encoding

Message ID 20240415100020.497574-1-claudio.bantaloukas@arm.com
State Committed
Headers
Series arm: Fix MVE vmla encoding |

Checks

Context Check Description
linaro-tcwg-bot/tcwg_binutils_build--master-arm success Testing passed
linaro-tcwg-bot/tcwg_binutils_build--master-aarch64 success Testing passed
linaro-tcwg-bot/tcwg_binutils_check--master-aarch64 success Testing passed
linaro-tcwg-bot/tcwg_binutils_check--master-arm success Testing passed

Commit Message

Claudio Bantaloukas April 15, 2024, 10 a.m. UTC
  Bit 12 of the first halfword in the VMLA instruction is listed as (0)
in the ARMARM (document DDI0553B.w, version ID07072023).
This means that the instruction does not discriminate between signed
and unsigned types and processing elements do not use the bit.
The encoding used by gas was based on an older version
of the document that made the sign important.
This change makes it possible to use vmla.i8 (16,32) in addition to
vmla.u8 and vmla.s8 mnemonics, with the i8, i16 and i32 aliases becoming
the default when disassembling.
The generated encoding sets bit 12 to 0, compatibly with other
assembler implementations.
---
Hi,

Is this Ok for master? I do not have commit rights, if OK, can someone commit on my behalf please?
Tested on arm-none-eabi.

Thanks,
Claudio Bantaloukas

 gas/config/tc-arm.c              |    4 +-
 gas/testsuite/gas/arm/mve-vmla.d | 3383 ++++++++++++++++++------------
 gas/testsuite/gas/arm/mve-vmla.s |    8 +-
 opcodes/arm-dis.c                |    2 +-
 4 files changed, 2041 insertions(+), 1356 deletions(-)
  

Comments

Nick Clifton April 23, 2024, 5:04 p.m. UTC | #1
Hi Claudio,

> Is this Ok for master? I do not have commit rights, if OK, can someone commit on my behalf please?
> Tested on arm-none-eabi.

Patch approved and applied.  I did have to make one change however.
The patch, as it was, added a new failure to the gas testsuite
for PE based ARM targets (eg arm-wince-pe):

   gas/testsuite/gas/arm/mve-vmla.s:20: Error: unknown pseudo-op: `.inst'>, no expected output
   FAIL: MVE vmla instructions

The .inst pseudo-op is ELF specific, so that is why the failure was
happening.  I choose the simplest solution of adding:

   #target: [is_elf_format]

to the mve-vmla.d test control file.  But you might prefer to make a
more complete solution by moving the .inst directive out of the mve-vmla.s
source file and into its own file...

Cheers
   Nick
  
Claudio Bantaloukas April 23, 2024, 5:36 p.m. UTC | #2
On 4/23/2024 6:04 PM, Nick Clifton wrote:
> Hi Claudio,
> 
>> Is this Ok for master? I do not have commit rights, if OK, can someone 
>> commit on my behalf please?
>> Tested on arm-none-eabi.
> 
> Patch approved and applied.  I did have to make one change however.
> The patch, as it was, added a new failure to the gas testsuite
> for PE based ARM targets (eg arm-wince-pe):


Hi Nick,

thank you for picking this up and for the fix.

I checked the result of the builds linked from patchwork but those do 
not cover arm-none-eabi, and, to be honest, I didn't even realize wince 
is still supported!
Is there another system that would allow me to catch such an error?

>    gas/testsuite/gas/arm/mve-vmla.s:20: Error: unknown pseudo-op: 
> `.inst'>, no expected output
>    FAIL: MVE vmla instructions
> 
> The .inst pseudo-op is ELF specific, so that is why the failure was
> happening.  I choose the simplest solution of adding:
> 
>    #target: [is_elf_format]
> 
> to the mve-vmla.d test control file.  But you might prefer to make a
> more complete solution by moving the .inst directive out of the mve-vmla.s
> source file and into its own file...

I'm learning new things every day. Your solution is spot on as I highly 
doubt any processor with MVE will be supported by wince. It also looks 
more succinct compared to other tests that do similar things with the 
more extensive

	#notarget: *-*-*coff *-*-pe *-*-wince *-*-*aout* *-*-netbsd

> 
> Cheers
>    Nick
>
  
Nick Clifton April 24, 2024, 10:47 a.m. UTC | #3
Hi Claudio,

> I checked the result of the builds linked from patchwork but those do not cover arm-none-eabi, and, to be honest, I didn't even realize wince is still supported!

Oh yes, there are still folks who care about ARMs and the PE format.

> Is there another system that would allow me to catch such an error?

You do not need one.  You can cross compile and run.  (In fact I do
all my testing on an x86_64 box.  Not an ARM in sight).  Just create
a new build directory and run:

   <path-to-binutils-sources>/configure --target=arm-wince-pe
   make all-gas all-binutils all-ld
   cd gas ; make check

Cheers
   Nick
  
Richard Earnshaw (lists) May 17, 2024, 2:31 p.m. UTC | #4
On 15/04/2024 11:00, Claudio Bantaloukas wrote:
> 
> Bit 12 of the first halfword in the VMLA instruction is listed as (0)
> in the ARMARM (document DDI0553B.w, version ID07072023).
> This means that the instruction does not discriminate between signed
> and unsigned types and processing elements do not use the bit.
> The encoding used by gas was based on an older version
> of the document that made the sign important.
> This change makes it possible to use vmla.i8 (16,32) in addition to
> vmla.u8 and vmla.s8 mnemonics, with the i8, i16 and i32 aliases becoming
> the default when disassembling.
> The generated encoding sets bit 12 to 0, compatibly with other
> assembler implementations.
> ---
> Hi,
> 
> Is this Ok for master? I do not have commit rights, if OK, can someone commit on my behalf please?
> Tested on arm-none-eabi.
> 
> Thanks,
> Claudio Bantaloukas
> 
>  gas/config/tc-arm.c              |    4 +-
>  gas/testsuite/gas/arm/mve-vmla.d | 3383 ++++++++++++++++++------------
>  gas/testsuite/gas/arm/mve-vmla.s |    8 +-
>  opcodes/arm-dis.c                |    2 +-
>  4 files changed, 2041 insertions(+), 1356 deletions(-)
> 

I think this patch is incomplete.  The current armv8-m Arm ARM also shows that VMLAS was also changed in a similar manner.  Were any other instructions affected?

R.
  
Richard Earnshaw (lists) May 17, 2024, 2:52 p.m. UTC | #5
On 23/04/2024 18:04, Nick Clifton wrote:
> Hi Claudio,
> 
>> Is this Ok for master? I do not have commit rights, if OK, can someone commit on my behalf please?
>> Tested on arm-none-eabi.
> 
> Patch approved and applied.  I did have to make one change however.
> The patch, as it was, added a new failure to the gas testsuite
> for PE based ARM targets (eg arm-wince-pe):
> 
>   gas/testsuite/gas/arm/mve-vmla.s:20: Error: unknown pseudo-op: `.inst'>, no expected output
>   FAIL: MVE vmla instructions
> 
> The .inst pseudo-op is ELF specific, 

Which begs the question as to why.  There's no real reason that I can see why .inst shouldn't work in COFF assembly.

R.
  

Patch

diff --git a/gas/config/tc-arm.c b/gas/config/tc-arm.c
index 89c85745adc..2aec97db7dc 100644
--- a/gas/config/tc-arm.c
+++ b/gas/config/tc-arm.c
@@ -17984,9 +17984,9 @@  do_neon_mac_maybe_scalar (void)
       constraint (!ARM_CPU_HAS_FEATURE (cpu_variant, mve_ext), BAD_FPU);

       enum neon_shape rs = neon_select_shape (NS_QQR, NS_NULL);
-      neon_check_type (3, rs, N_EQK, N_EQK, N_SU_MVE | N_KEY);
+      neon_check_type (3, rs, N_EQK, N_EQK, N_SU_MVE | N_I_MVE | N_KEY);

-      neon_dyadic_misc (NT_unsigned, N_SU_MVE, 0);
+      neon_dyadic_misc (NT_untyped, N_SU_MVE | N_I_MVE, 0);
     }
   else
     {
diff --git a/gas/testsuite/gas/arm/mve-vmla.d b/gas/testsuite/gas/arm/mve-vmla.d
index 3ca4d429519..fc85da24c1d 100644
--- a/gas/testsuite/gas/arm/mve-vmla.d
+++ b/gas/testsuite/gas/arm/mve-vmla.d
@@ -5,1356 +5,2035 @@ 
 .*: +file format .*arm.*

 Disassembly of section .text:
-[^>]*> ee01 0e40 	vmla.s8	q0, q0, r0
-[^>]*> ee01 0e41 	vmla.s8	q0, q0, r1
-[^>]*> ee01 0e42 	vmla.s8	q0, q0, r2
-[^>]*> ee01 0e44 	vmla.s8	q0, q0, r4
-[^>]*> ee01 0e47 	vmla.s8	q0, q0, r7
-[^>]*> ee01 0e48 	vmla.s8	q0, q0, r8
-[^>]*> ee01 0e4a 	vmla.s8	q0, q0, sl
-[^>]*> ee01 0e4c 	vmla.s8	q0, q0, ip
-[^>]*> ee01 0e4e 	vmla.s8	q0, q0, lr
-[^>]*> ee03 0e40 	vmla.s8	q0, q1, r0
-[^>]*> ee03 0e41 	vmla.s8	q0, q1, r1
-[^>]*> ee03 0e42 	vmla.s8	q0, q1, r2
-[^>]*> ee03 0e44 	vmla.s8	q0, q1, r4
-[^>]*> ee03 0e47 	vmla.s8	q0, q1, r7
-[^>]*> ee03 0e48 	vmla.s8	q0, q1, r8
-[^>]*> ee03 0e4a 	vmla.s8	q0, q1, sl
-[^>]*> ee03 0e4c 	vmla.s8	q0, q1, ip
-[^>]*> ee03 0e4e 	vmla.s8	q0, q1, lr
-[^>]*> ee05 0e40 	vmla.s8	q0, q2, r0
-[^>]*> ee05 0e41 	vmla.s8	q0, q2, r1
-[^>]*> ee05 0e42 	vmla.s8	q0, q2, r2
-[^>]*> ee05 0e44 	vmla.s8	q0, q2, r4
-[^>]*> ee05 0e47 	vmla.s8	q0, q2, r7
-[^>]*> ee05 0e48 	vmla.s8	q0, q2, r8
-[^>]*> ee05 0e4a 	vmla.s8	q0, q2, sl
-[^>]*> ee05 0e4c 	vmla.s8	q0, q2, ip
-[^>]*> ee05 0e4e 	vmla.s8	q0, q2, lr
-[^>]*> ee09 0e40 	vmla.s8	q0, q4, r0
-[^>]*> ee09 0e41 	vmla.s8	q0, q4, r1
-[^>]*> ee09 0e42 	vmla.s8	q0, q4, r2
-[^>]*> ee09 0e44 	vmla.s8	q0, q4, r4
-[^>]*> ee09 0e47 	vmla.s8	q0, q4, r7
-[^>]*> ee09 0e48 	vmla.s8	q0, q4, r8
-[^>]*> ee09 0e4a 	vmla.s8	q0, q4, sl
-[^>]*> ee09 0e4c 	vmla.s8	q0, q4, ip
-[^>]*> ee09 0e4e 	vmla.s8	q0, q4, lr
-[^>]*> ee0f 0e40 	vmla.s8	q0, q7, r0
-[^>]*> ee0f 0e41 	vmla.s8	q0, q7, r1
-[^>]*> ee0f 0e42 	vmla.s8	q0, q7, r2
-[^>]*> ee0f 0e44 	vmla.s8	q0, q7, r4
-[^>]*> ee0f 0e47 	vmla.s8	q0, q7, r7
-[^>]*> ee0f 0e48 	vmla.s8	q0, q7, r8
-[^>]*> ee0f 0e4a 	vmla.s8	q0, q7, sl
-[^>]*> ee0f 0e4c 	vmla.s8	q0, q7, ip
-[^>]*> ee0f 0e4e 	vmla.s8	q0, q7, lr
-[^>]*> ee01 2e40 	vmla.s8	q1, q0, r0
-[^>]*> ee01 2e41 	vmla.s8	q1, q0, r1
-[^>]*> ee01 2e42 	vmla.s8	q1, q0, r2
-[^>]*> ee01 2e44 	vmla.s8	q1, q0, r4
-[^>]*> ee01 2e47 	vmla.s8	q1, q0, r7
-[^>]*> ee01 2e48 	vmla.s8	q1, q0, r8
-[^>]*> ee01 2e4a 	vmla.s8	q1, q0, sl
-[^>]*> ee01 2e4c 	vmla.s8	q1, q0, ip
-[^>]*> ee01 2e4e 	vmla.s8	q1, q0, lr
-[^>]*> ee03 2e40 	vmla.s8	q1, q1, r0
-[^>]*> ee03 2e41 	vmla.s8	q1, q1, r1
-[^>]*> ee03 2e42 	vmla.s8	q1, q1, r2
-[^>]*> ee03 2e44 	vmla.s8	q1, q1, r4
-[^>]*> ee03 2e47 	vmla.s8	q1, q1, r7
-[^>]*> ee03 2e48 	vmla.s8	q1, q1, r8
-[^>]*> ee03 2e4a 	vmla.s8	q1, q1, sl
-[^>]*> ee03 2e4c 	vmla.s8	q1, q1, ip
-[^>]*> ee03 2e4e 	vmla.s8	q1, q1, lr
-[^>]*> ee05 2e40 	vmla.s8	q1, q2, r0
-[^>]*> ee05 2e41 	vmla.s8	q1, q2, r1
-[^>]*> ee05 2e42 	vmla.s8	q1, q2, r2
-[^>]*> ee05 2e44 	vmla.s8	q1, q2, r4
-[^>]*> ee05 2e47 	vmla.s8	q1, q2, r7
-[^>]*> ee05 2e48 	vmla.s8	q1, q2, r8
-[^>]*> ee05 2e4a 	vmla.s8	q1, q2, sl
-[^>]*> ee05 2e4c 	vmla.s8	q1, q2, ip
-[^>]*> ee05 2e4e 	vmla.s8	q1, q2, lr
-[^>]*> ee09 2e40 	vmla.s8	q1, q4, r0
-[^>]*> ee09 2e41 	vmla.s8	q1, q4, r1
-[^>]*> ee09 2e42 	vmla.s8	q1, q4, r2
-[^>]*> ee09 2e44 	vmla.s8	q1, q4, r4
-[^>]*> ee09 2e47 	vmla.s8	q1, q4, r7
-[^>]*> ee09 2e48 	vmla.s8	q1, q4, r8
-[^>]*> ee09 2e4a 	vmla.s8	q1, q4, sl
-[^>]*> ee09 2e4c 	vmla.s8	q1, q4, ip
-[^>]*> ee09 2e4e 	vmla.s8	q1, q4, lr
-[^>]*> ee0f 2e40 	vmla.s8	q1, q7, r0
-[^>]*> ee0f 2e41 	vmla.s8	q1, q7, r1
-[^>]*> ee0f 2e42 	vmla.s8	q1, q7, r2
-[^>]*> ee0f 2e44 	vmla.s8	q1, q7, r4
-[^>]*> ee0f 2e47 	vmla.s8	q1, q7, r7
-[^>]*> ee0f 2e48 	vmla.s8	q1, q7, r8
-[^>]*> ee0f 2e4a 	vmla.s8	q1, q7, sl
-[^>]*> ee0f 2e4c 	vmla.s8	q1, q7, ip
-[^>]*> ee0f 2e4e 	vmla.s8	q1, q7, lr
-[^>]*> ee01 4e40 	vmla.s8	q2, q0, r0
-[^>]*> ee01 4e41 	vmla.s8	q2, q0, r1
-[^>]*> ee01 4e42 	vmla.s8	q2, q0, r2
-[^>]*> ee01 4e44 	vmla.s8	q2, q0, r4
-[^>]*> ee01 4e47 	vmla.s8	q2, q0, r7
-[^>]*> ee01 4e48 	vmla.s8	q2, q0, r8
-[^>]*> ee01 4e4a 	vmla.s8	q2, q0, sl
-[^>]*> ee01 4e4c 	vmla.s8	q2, q0, ip
-[^>]*> ee01 4e4e 	vmla.s8	q2, q0, lr
-[^>]*> ee03 4e40 	vmla.s8	q2, q1, r0
-[^>]*> ee03 4e41 	vmla.s8	q2, q1, r1
-[^>]*> ee03 4e42 	vmla.s8	q2, q1, r2
-[^>]*> ee03 4e44 	vmla.s8	q2, q1, r4
-[^>]*> ee03 4e47 	vmla.s8	q2, q1, r7
-[^>]*> ee03 4e48 	vmla.s8	q2, q1, r8
-[^>]*> ee03 4e4a 	vmla.s8	q2, q1, sl
-[^>]*> ee03 4e4c 	vmla.s8	q2, q1, ip
-[^>]*> ee03 4e4e 	vmla.s8	q2, q1, lr
-[^>]*> ee05 4e40 	vmla.s8	q2, q2, r0
-[^>]*> ee05 4e41 	vmla.s8	q2, q2, r1
-[^>]*> ee05 4e42 	vmla.s8	q2, q2, r2
-[^>]*> ee05 4e44 	vmla.s8	q2, q2, r4
-[^>]*> ee05 4e47 	vmla.s8	q2, q2, r7
-[^>]*> ee05 4e48 	vmla.s8	q2, q2, r8
-[^>]*> ee05 4e4a 	vmla.s8	q2, q2, sl
-[^>]*> ee05 4e4c 	vmla.s8	q2, q2, ip
-[^>]*> ee05 4e4e 	vmla.s8	q2, q2, lr
-[^>]*> ee09 4e40 	vmla.s8	q2, q4, r0
-[^>]*> ee09 4e41 	vmla.s8	q2, q4, r1
-[^>]*> ee09 4e42 	vmla.s8	q2, q4, r2
-[^>]*> ee09 4e44 	vmla.s8	q2, q4, r4
-[^>]*> ee09 4e47 	vmla.s8	q2, q4, r7
-[^>]*> ee09 4e48 	vmla.s8	q2, q4, r8
-[^>]*> ee09 4e4a 	vmla.s8	q2, q4, sl
-[^>]*> ee09 4e4c 	vmla.s8	q2, q4, ip
-[^>]*> ee09 4e4e 	vmla.s8	q2, q4, lr
-[^>]*> ee0f 4e40 	vmla.s8	q2, q7, r0
-[^>]*> ee0f 4e41 	vmla.s8	q2, q7, r1
-[^>]*> ee0f 4e42 	vmla.s8	q2, q7, r2
-[^>]*> ee0f 4e44 	vmla.s8	q2, q7, r4
-[^>]*> ee0f 4e47 	vmla.s8	q2, q7, r7
-[^>]*> ee0f 4e48 	vmla.s8	q2, q7, r8
-[^>]*> ee0f 4e4a 	vmla.s8	q2, q7, sl
-[^>]*> ee0f 4e4c 	vmla.s8	q2, q7, ip
-[^>]*> ee0f 4e4e 	vmla.s8	q2, q7, lr
-[^>]*> ee01 8e40 	vmla.s8	q4, q0, r0
-[^>]*> ee01 8e41 	vmla.s8	q4, q0, r1
-[^>]*> ee01 8e42 	vmla.s8	q4, q0, r2
-[^>]*> ee01 8e44 	vmla.s8	q4, q0, r4
-[^>]*> ee01 8e47 	vmla.s8	q4, q0, r7
-[^>]*> ee01 8e48 	vmla.s8	q4, q0, r8
-[^>]*> ee01 8e4a 	vmla.s8	q4, q0, sl
-[^>]*> ee01 8e4c 	vmla.s8	q4, q0, ip
-[^>]*> ee01 8e4e 	vmla.s8	q4, q0, lr
-[^>]*> ee03 8e40 	vmla.s8	q4, q1, r0
-[^>]*> ee03 8e41 	vmla.s8	q4, q1, r1
-[^>]*> ee03 8e42 	vmla.s8	q4, q1, r2
-[^>]*> ee03 8e44 	vmla.s8	q4, q1, r4
-[^>]*> ee03 8e47 	vmla.s8	q4, q1, r7
-[^>]*> ee03 8e48 	vmla.s8	q4, q1, r8
-[^>]*> ee03 8e4a 	vmla.s8	q4, q1, sl
-[^>]*> ee03 8e4c 	vmla.s8	q4, q1, ip
-[^>]*> ee03 8e4e 	vmla.s8	q4, q1, lr
-[^>]*> ee05 8e40 	vmla.s8	q4, q2, r0
-[^>]*> ee05 8e41 	vmla.s8	q4, q2, r1
-[^>]*> ee05 8e42 	vmla.s8	q4, q2, r2
-[^>]*> ee05 8e44 	vmla.s8	q4, q2, r4
-[^>]*> ee05 8e47 	vmla.s8	q4, q2, r7
-[^>]*> ee05 8e48 	vmla.s8	q4, q2, r8
-[^>]*> ee05 8e4a 	vmla.s8	q4, q2, sl
-[^>]*> ee05 8e4c 	vmla.s8	q4, q2, ip
-[^>]*> ee05 8e4e 	vmla.s8	q4, q2, lr
-[^>]*> ee09 8e40 	vmla.s8	q4, q4, r0
-[^>]*> ee09 8e41 	vmla.s8	q4, q4, r1
-[^>]*> ee09 8e42 	vmla.s8	q4, q4, r2
-[^>]*> ee09 8e44 	vmla.s8	q4, q4, r4
-[^>]*> ee09 8e47 	vmla.s8	q4, q4, r7
-[^>]*> ee09 8e48 	vmla.s8	q4, q4, r8
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+[^>]*> ee09 8e4c 	vmla.i8	q4, q4, ip
+[^>]*> ee09 8e4e 	vmla.i8	q4, q4, lr
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+[^>]*> ee2f 0e4c 	vmla.i32	q0, q7, ip
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+[^>]*> ee21 2e4c 	vmla.i32	q1, q0, ip
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+[^>]*> ee09 2e47 	vmla.i8	q1, q4, r7
+[^>]*> ee09 2e48 	vmla.i8	q1, q4, r8
+[^>]*> ee09 2e4a 	vmla.i8	q1, q4, sl
+[^>]*> ee09 2e4c 	vmla.i8	q1, q4, ip
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+[^>]*> ee0f 2e42 	vmla.i8	q1, q7, r2
+[^>]*> ee0f 2e44 	vmla.i8	q1, q7, r4
+[^>]*> ee0f 2e47 	vmla.i8	q1, q7, r7
+[^>]*> ee0f 2e48 	vmla.i8	q1, q7, r8
+[^>]*> ee0f 2e4a 	vmla.i8	q1, q7, sl
+[^>]*> ee0f 2e4c 	vmla.i8	q1, q7, ip
+[^>]*> ee0f 2e4e 	vmla.i8	q1, q7, lr
+[^>]*> ee01 4e40 	vmla.i8	q2, q0, r0
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+[^>]*> ee19 4e4a 	vmla.i16	q2, q4, sl
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+[^>]*> ee19 4e4e 	vmla.i16	q2, q4, lr
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+[^>]*> ee1f 4e42 	vmla.i16	q2, q7, r2
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+[^>]*> ee29 8e47 	vmla.i32	q4, q4, r7
+[^>]*> ee29 8e48 	vmla.i32	q4, q4, r8
+[^>]*> ee29 8e4a 	vmla.i32	q4, q4, sl
+[^>]*> ee29 8e4c 	vmla.i32	q4, q4, ip
+[^>]*> ee29 8e4e 	vmla.i32	q4, q4, lr
+[^>]*> ee2f 8e40 	vmla.i32	q4, q7, r0
+[^>]*> ee2f 8e41 	vmla.i32	q4, q7, r1
+[^>]*> ee2f 8e42 	vmla.i32	q4, q7, r2
+[^>]*> ee2f 8e44 	vmla.i32	q4, q7, r4
+[^>]*> ee2f 8e47 	vmla.i32	q4, q7, r7
+[^>]*> ee2f 8e48 	vmla.i32	q4, q7, r8
+[^>]*> ee2f 8e4a 	vmla.i32	q4, q7, sl
+[^>]*> ee2f 8e4c 	vmla.i32	q4, q7, ip
+[^>]*> ee2f 8e4e 	vmla.i32	q4, q7, lr
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 [^>]*> fe71 8f4d 	vpste
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diff --git a/gas/testsuite/gas/arm/mve-vmla.s b/gas/testsuite/gas/arm/mve-vmla.s
index 7ffd60f76e2..2e5af1d7651 100644
--- a/gas/testsuite/gas/arm/mve-vmla.s
+++ b/gas/testsuite/gas/arm/mve-vmla.s
@@ -1,6 +1,6 @@ 
 .syntax unified
 .thumb
-.irp data, s8, u8, s16, u16, s32, u32
+.irp data, s8, u8, s16, u16, s32, u32, i8, i16, i32
 .irp op1, q0, q1, q2, q4, q7
 .irp op2, q0, q1, q2, q4, q7
 .irp op3, r0, r1, r2, r4, r7, r8, r10, r12, r14
@@ -12,3 +12,9 @@  vmla.\data \op1, \op2, \op3
 vpste
 vmlat.u8 q0, q1, r2
 vmlae.s8 q7, q7, r14
+vpste
+vmlat.i8 q0, q1, r2
+vmlae.i8 q7, q7, r14
+
+@ bit 12 is ignored, should decode as vmla.i8 q0, q0, r0
+.inst 0xfe010e40
diff --git a/opcodes/arm-dis.c b/opcodes/arm-dis.c
index 6550cf40f69..d076be19ca0 100644
--- a/opcodes/arm-dis.c
+++ b/opcodes/arm-dis.c
@@ -2763,7 +2763,7 @@  static const struct mopcode32 mve_opcodes[] =
   {ARM_FEATURE_CORE_HIGH (ARM_EXT2_MVE),
    MVE_VMLA,
    0xee010e40, 0xef811f70,
-   "vmla%v.%u%20-21s\t%13-15,22Q, %17-19,7Q, %0-3r"},
+   "vmla%v.i%20-21s\t%13-15,22Q, %17-19,7Q, %0-3r"},

   /* Vector VMLALDAV.  Note must appear before VMLADAV due to instruction
      opcode aliasing.  */